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Uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável para a arquitetura ChipCflow: módulo de conversão C em grafo a fluxo de dados
Uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável para a arquitetura ChipCflow: módulo de conversão C em grafo a fluxo de dados
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Uma ferramenta para execução de algoritmos utilizando o modelo a fluxo de dados dinâmico em hardware reconfigurável para a arquitetura ChipCflow: módulo de conversão C em grafo a fluxo de dados

Costa, Kelton Augusto Pontara Da

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola de Engenharia de São Carlos 2009-07-03

Acesso online

2
Análise de processadores para aplicação em tempo real do método do gradiente conjugado no controle ótimo de processos
Análise de processadores para aplicação em tempo real do método do gradiente conjugado no controle ótimo de processos
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Análise de processadores para aplicação em tempo real do método do gradiente conjugado no controle ótimo de processos

Fischer, Benedito René

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Física de São Carlos 1995-01-10

Acesso online. A biblioteca também possui exemplares impressos.

3
Reconfigurable architecture for binary images invariant moments extraction
Reconfigurable architecture for binary images invariant moments extraction
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Reconfigurable architecture for binary images invariant moments extraction

Guilherme Henrique Reno Jorge Valentin Obac Roda; Juan Pablo Oliver; Julio Perez Acle; Sebastian Fernández; Southern Conference on Programmable Logic (5. 2009 São Carlos, SP)

Proceedings Piscataway : IEEE, 2009

Piscataway IEEE 2009

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4
Arquitetura para extração de características invariantes em imagens binárias utilizando dispositivos de lógica programável complexa
Arquitetura para extração de características invariantes em imagens binárias utilizando dispositivos de lógica programável complexa
Material Type:
Dissertação de Mestrado 		Adicionar ao Meu Espaço

Arquitetura para extração de características invariantes em imagens binárias utilizando dispositivos de lógica programável complexa

Jorge, Guilherme Henrique Renó

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Escola de Engenharia de São Carlos 2006-08-17

Acesso online

5
Arquiteturas para dilatação exata
Arquiteturas para dilatação exata
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Arquiteturas para dilatação exata

Luppe, Maximiliam

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Física de São Carlos 2003-03-14

Acesso online. A biblioteca também possui exemplares impressos.

6
Desenvolvimento de um processador pipeline dedicado para extração de bordas em tempo real
Desenvolvimento de um processador pipeline dedicado para extração de bordas em tempo real
Material Type:
Dissertação de Mestrado 		Adicionar ao Meu Espaço

Desenvolvimento de um processador pipeline dedicado para extração de bordas em tempo real

Luppe, Maximiliam

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Física de São Carlos 1997-06-24

Acesso online. A biblioteca também possui exemplares impressos.

7
Real time architecture for edge detection from standard video signal
Real time architecture for edge detection from standard video signal
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

Real time architecture for edge detection from standard video signal

Valentin Obac Roda Maximiliam Luppe; International Conference on Reconfigurable Computing and FPGAs (2004 Colima)

Proceedings Colima, 2004

Colima 2004

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8
On the effect of spare positioning on the reconfigurability of two-dimensional processor arrays
On the effect of spare positioning on the reconfigurability of two-dimensional processor arrays
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

On the effect of spare positioning on the reconfigurability of two-dimensional processor arrays

Valentin Obac Roda T T Y Lin; Aizu International Symposium on Parallel Algorithms/Architecture Synthesis (1995 Fukushima)

Proceedings Fukushima : University of Aizu, 1995

Fukushima University of Aizu 1995

Localização: IFSC - Inst. Física de São Carlos    (PROD003408 ) e outros locais(Acessar)

9
Visão computacional rápida utilizando rede neural implementada em processamento paralelo
Visão computacional rápida utilizando rede neural implementada em processamento paralelo
Material Type:
Tese de Doutorado 		Adicionar ao Meu Espaço

Visão computacional rápida utilizando rede neural implementada em processamento paralelo

Oliveira, Roberto Alves De

Biblioteca Digital de Teses e Dissertações da USP; Universidade de São Paulo; Instituto de Física de São Carlos 2002-09-20

Acesso online. A biblioteca também possui exemplares impressos.

10
An FPGA-based region-growing architecture for binary images
An FPGA-based region-growing architecture for binary images
Material Type:
Artigo de Congresso 		Adicionar ao Meu Espaço

An FPGA-based region-growing architecture for binary images

Emerson Carlos Pedrino José Hiroki Saito; Hermes Senger; Valentin Obac Roda; Marcelo Marinho; International Conference on Systems, Signals and Image Processing (17. 2010 Rio de Janeiro, RJ)

IWSSIP Proceedings Rio de Janeiro : EdUFF, 2010

Rio de Janeiro EdUFF 2010

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Deste Autor:

  1. Obac Roda, V
  2. Pedrino, E
  3. Roda, V
  4. Saito, J
  5. Luppe, M

Neste Assunto:

  1. Processamento De Imagens
  2. Arquiteturas Paralelas
  3. Programação Genética
  4. Reconhecimento De Padrões
  5. Tempo Real

  • Realização: ABCD-USP USP   Logos de Redes Sociais: Freepik

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