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A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression
A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression
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A 0.0023 mm ^2/ch. Delta-Encoded, Time-Division Multiplexed Mixed-Signal ECoG Recording Architecture With Stimulus Artifact Suppression

Uehlin, John P. ; Smith, William Anthony ; Pamula, V. Rajesh ; Perlmutter, Steve I. ; Rudell, Jacques C. ; Sathe, Visvesh S.

IEEE transactions on biomedical circuits and systems, 2020-04, Vol.14 (2), p.319-331 [Periódico revisado por pares]

United States: IEEE

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2
A 0.0043-mm2 0.085-μW/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R-RC Network
A 0.0043-mm2 0.085-μW/MHz Relaxation Oscillator Using Charge-Prestored Asymmetric Swings R-RC Network
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Wei, Yuchen ; Yang, Shiheng ; Liu, Yueduo ; Bao, Rongxin ; Zhu, Zihao ; Lin, Jiahui ; Zhang, Zehao ; Chen, Yong ; Yin, Jun ; Mak, Pui-In ; Li, Qiang

IEEE transactions on very large scale integration (VLSI) systems, 2023-08, Vol.31 (8), p.1248-1252 [Periódico revisado por pares]

New York: IEEE

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3
A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS
A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS
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A 0.009 mm2 Wide-Tuning Range Automatically Placed-and-Routed ADPLL in 14-nm FinFET CMOS

Moore, David M. ; Xanthopoulos, Thucydides ; Meninger, Scott ; Wentzloff, David D.

IEEE solid-state circuits letters, 2018-03, Vol.1 (3), p.74-77 [Periódico revisado por pares]

IEEE

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4
A 0.013 }^, 5 \mu\hbox , DC-Coupled Neural Signal Acquisition IC With 0.5 V Supply
A 0.013 }^, 5 \mu\hbox , DC-Coupled Neural Signal Acquisition IC With 0.5 V Supply
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Muller, R. ; Gambini, S. ; Rabaey, J. M.

IEEE journal of solid-state circuits, 2012-01, Vol.47 (1), p.232-243 [Periódico revisado por pares]

IEEE

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5
A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS
A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS
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A 0.013-mm2 0.53-mW/Gb/s 32-Gb/s Hybrid Analog Equalizer Under 21-dB Channel Loss in 65-nm CMOS

Balachandran, Arya ; Chen, Yong ; Boon, Chirn Chye

IEEE transactions on very large scale integration (VLSI) systems, 2018-03, Vol.26 (3), p.599-603 [Periódico revisado por pares]

IEEE

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6
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology
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A 0.015-mm ^} Inductorless 32-GHz Clock Generator With Wide Frequency-Tuning Range in 28-nm CMOS Technology

Jeong, Gyu-Seob ; Kim, Wooseok ; Park, Jaejin ; Kim, Taeik ; Park, Hojin ; Jeong, Deog-Kyoon

IEEE transactions on circuits and systems. II, Express briefs, 2017-06, Vol.64 (6), p.655-659 [Periódico revisado por pares]

New York: IEEE

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7
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme
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A 0.016 mV/mA Cross-Regulation 5-Output SIMO DC-DC Buck Converter Using Output-Voltage-Aware Charge Control Scheme

Ngoc-Son Pham ; Taegeun Yoo ; Kim, Tony Tae-Hyoung ; Chan-Gun Lee ; Kwang-Hyun Baek

IEEE transactions on power electronics, 2018-11, Vol.33 (11), p.9619-9630 [Periódico revisado por pares]

New York: IEEE

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8
A 0.025-mm2 0.8-V 78.5-dB SNDR VCO-Based Sensor Readout Circuit in a Hybrid PLL- \Delta\Sigma M Structure
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A 0.025-mm2 0.8-V 78.5-dB SNDR VCO-Based Sensor Readout Circuit in a Hybrid PLL- \Delta\Sigma M Structure

Zhao, Wenda ; Li, Shaolan ; Xu, Biying ; Yang, Xiangxing ; Tang, Xiyuan ; Shen, Linxiao ; Lu, Nanshu ; Pan, David Z. ; Sun, Nan

IEEE journal of solid-state circuits, 2020-03, Vol.55 (3), p.666-679 [Periódico revisado por pares]

IEEE

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9
A 0.065-mm2 19.8-mW Single-Channel Calibration-Free 12-b 600-MS/s ADC in 28-nm UTBB FD-SOI Using FBB
A 0.065-mm2 19.8-mW Single-Channel Calibration-Free 12-b 600-MS/s ADC in 28-nm UTBB FD-SOI Using FBB
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A 0.065-mm2 19.8-mW Single-Channel Calibration-Free 12-b 600-MS/s ADC in 28-nm UTBB FD-SOI Using FBB

Kumar, Ashish ; Debnath, Chandrajit ; Singh, Pratap Narayan ; Bhatia, Vivek ; Chaudhary, Shivani ; Jain, Vigyan ; Le Tual, Stephane ; Malik, Rakesh

IEEE journal of solid-state circuits, 2017-07, Vol.52 (7), p.1927-1939 [Periódico revisado por pares]

IEEE

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10
A 0.07 mm ^2 Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization
A 0.07 mm ^2 Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization
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A 0.07 mm ^2 Asynchronous Logic CMOS Pulsed Receiver Based on Radio Events Self-Synchronization

Crepaldi, Marco ; Macis, Silvia ; Ros, Paolo Motto ; Demarchi, Danilo

IEEE transactions on circuits and systems. I, Regular papers, 2014-03, Vol.61 (3), p.750-763 [Periódico revisado por pares]

IEEE

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