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0.16-0.25 pJ/bit, 8 Gb/s Near-Threshold Serial Link Receiver With Super-Harmonic Injection-Locking
0.16-0.25 pJ/bit, 8 Gb/s Near-Threshold Serial Link Receiver With Super-Harmonic Injection-Locking
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0.16-0.25 pJ/bit, 8 Gb/s Near-Threshold Serial Link Receiver With Super-Harmonic Injection-Locking

Kangmin Hu ; Rui Bai ; Tao Jiang ; Chao Ma ; Ragab, A. ; Palermo, S. ; Chiang, P. Y.

IEEE journal of solid-state circuits, 2012-08, Vol.47 (8), p.1842-1853 [Revista revisada por pares]

New York, NY: IEEE

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2
A 0.001-mm2 112.32-μW All-Digital PLL with Dual-Tuned DCO and Dual-Tuned Control Algorithm
A 0.001-mm2 112.32-μW All-Digital PLL with Dual-Tuned DCO and Dual-Tuned Control Algorithm
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A 0.001-mm2 112.32-μW All-Digital PLL with Dual-Tuned DCO and Dual-Tuned Control Algorithm

Zhang, Peiyong ; Su, Yuquan ; Yang, Yiwei

Circuits, systems, and signal processing, 2022-03, Vol.41 (3), p.1563-1576 [Revista revisada por pares]

New York: Springer US

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3
A 0.0012 mm2 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS
A 0.0012 mm2 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS
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A 0.0012 mm2 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS

An, Eun-Ji ; Oh, Dong-Ryeol

Electronics (Basel), 2022-05, Vol.11 (11), p.1707 [Revista revisada por pares]

Basel: MDPI AG

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4
A 0.0012 mm[sup.2] 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS
A 0.0012 mm[sup.2] 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS
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A 0.0012 mm[sup.2] 6-bit 700 MS/s 1 mW Calibration-Free Pseudo-Loop-Unrolled SAR ADC in 28 nm CMOS

An, Eun-Ji ; Oh, Dong-Ryeol

Electronics (Basel), 2022-06, Vol.11 (11) [Revista revisada por pares]

MDPI AG

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5
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS
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A 0.004% resolution & SAT<1.8 μson-chip adaptive anti-aging system using cuckoo intelligence-based algorithm in 65 nm CMOS

Zhang, Yuejun ; Zhang, Haiming ; Wang, Pengjun ; Wu, Qiufeng ; Li, Gang

Integration (Amsterdam), 2021-05, Vol.78, p.135-143 [Revista revisada por pares]

Amsterdam: Elsevier B.V

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6
A 0.086-mm ^2 12.7-pJ/SOP 64k-Synapse 256-Neuron Online-Learning Digital Spiking Neuromorphic Processor in 28-nm CMOS
A 0.086-mm ^2 12.7-pJ/SOP 64k-Synapse 256-Neuron Online-Learning Digital Spiking Neuromorphic Processor in 28-nm CMOS
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A 0.086-mm ^2 12.7-pJ/SOP 64k-Synapse 256-Neuron Online-Learning Digital Spiking Neuromorphic Processor in 28-nm CMOS

Frenkel, Charlotte ; Lefebvre, Martin ; Legat, Jean-Didier ; Bol, David

IEEE transactions on biomedical circuits and systems, 2019-02, Vol.13 (1), p.145-158 [Revista revisada por pares]

United States: IEEE

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7
A 0.13-[Formula Omitted] CMOS SoC for Simultaneous Multichannel Optogenetics and Neural Recording
A 0.13-[Formula Omitted] CMOS SoC for Simultaneous Multichannel Optogenetics and Neural Recording
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A 0.13-[Formula Omitted] CMOS SoC for Simultaneous Multichannel Optogenetics and Neural Recording

Gagnon-Turcotte, Gabriel ; Mehdi Noormohammadi Khiarak ; Ethier, Christian ; De Koninck, Yves ; Gosselin, Benoit

IEEE journal of solid-state circuits, 2018-01, Vol.53 (11), p.3087 [Revista revisada por pares]

New York: The Institute of Electrical and Electronics Engineers, Inc. (IEEE)

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8
A 0.18 pJ/Step Time-Domain 1st Order &#916;&#931; Capacitance-to-Digital Converter in 65-nm CMOS
A 0.18 pJ/Step Time-Domain 1st Order &#916;&#931; Capacitance-to-Digital Converter in 65-nm CMOS
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A 0.18 pJ/Step Time-Domain 1st Order ΔΣ Capacitance-to-Digital Converter in 65-nm CMOS

Karmakar, Arijit ; De Smedt, Valentijn ; Leroux, Paul

2021 IEEE International Symposium on Circuits and Systems (ISCAS), 2021, p.1-5

IEEE

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9
A 0.18 &#956;m CMOS linear-in-dB AGC post-amplifier for optical communications
A 0.18 &#956;m CMOS linear-in-dB AGC post-amplifier for optical communications
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A 0.18 μm CMOS linear-in-dB AGC post-amplifier for optical communications

Aznar, Francisco ; Celma, Santiago ; Calvo, Belén

Microelectronics and reliability, 2011-05, Vol.51 (5), p.959-964 [Revista revisada por pares]

Kidlington: Elsevier Ltd

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10
A 0.18-&#956;m CMOS X-Band Shock Wave Generator with an On-Chip Dipole Antenna and a Digitally Programmable Delay Circuit for Pulse Beam-Formability : Circuits and Desig Techniques for Advanced Large Scale Integration
A 0.18-&#956;m CMOS X-Band Shock Wave Generator with an On-Chip Dipole Antenna and a Digitally Programmable Delay Circuit for Pulse Beam-Formability : Circuits and Desig Techniques for Advanced Large Scale Integration
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A 0.18-μm CMOS X-Band Shock Wave Generator with an On-Chip Dipole Antenna and a Digitally Programmable Delay Circuit for Pulse Beam-Formability : Circuits and Desig Techniques for Advanced Large Scale Integration

KHANH, Nguyen Ngoc Mai ; SASAKI, Masahiro ; ASADA, Kunihiro

IEICE transactions on electronics, 2011, Vol.94 (4), p.627-634 [Revista revisada por pares]

Oxford: Oxford University Press

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