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100 Gbit/s authenticated encryption based on quantum key distribution
100 Gbit/s authenticated encryption based on quantum key distribution
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100 Gbit/s authenticated encryption based on quantum key distribution

Muehlberghuber, Michael ; Keller, Christoph ; Felber, Norbert ; Pendl, Christian

2012 IEEE/IFIP 20th International Conference on VLSI and System-On-Chip, 2012, p.123-128

IEEE

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2
237 Gbit/s unrolled hardware polar decoder
237 Gbit/s unrolled hardware polar decoder
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Artigo 		Adicionar ao Meu Espaço

237 Gbit/s unrolled hardware polar decoder

Giard, P ; Sarkis, G ; Thibeault, C ; Gross, W.J

Electronics letters, 2015-05, Vol.51 (10), p.762-763 [Periódico revisado por pares]

The Institution of Engineering and Technology

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A 0.61-μJ/Frame Pipelined Wired-logic DNN Processor in 16-nm FPGA Using Convolutional Non-Linear Neural Network
A 0.61-μJ/Frame Pipelined Wired-logic DNN Processor in 16-nm FPGA Using Convolutional Non-Linear Neural Network
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Artigo 		Adicionar ao Meu Espaço

A 0.61-μJ/Frame Pipelined Wired-logic DNN Processor in 16-nm FPGA Using Convolutional Non-Linear Neural Network

Kosuge, Atsutake ; Hsu, Yao-Chung ; Hamada, Mototsugu ; Kuroda, Tadahiro

IEEE open journal of circuits and systems, 2022, Vol.3, p.4-14 [Periódico revisado por pares]

New York: IEEE

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4
A 16 nJ/Classification FPGA-Based Wired-Logic DNN Accelerator Using Fixed-Weight Non-Linear Neural Net
A 16 nJ/Classification FPGA-Based Wired-Logic DNN Accelerator Using Fixed-Weight Non-Linear Neural Net
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Artigo 		Adicionar ao Meu Espaço

A 16 nJ/Classification FPGA-Based Wired-Logic DNN Accelerator Using Fixed-Weight Non-Linear Neural Net

Kosuge, Atsutake ; Hamada, Mototsugu ; Kuroda, Tadahiro

IEEE journal on emerging and selected topics in circuits and systems, 2021-12, Vol.11 (4), p.751-761 [Periódico revisado por pares]

Piscataway: IEEE

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5
A 2-D Multiple Transform Processor for the Versatile Video Coding Standard
A 2-D Multiple Transform Processor for the Versatile Video Coding Standard
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A 2-D Multiple Transform Processor for the Versatile Video Coding Standard

Garrido, Matias J. ; Pescador, Fernando ; Chavarrias, M. ; Lobo, P. J. ; Sanz, Cesar

IEEE transactions on consumer electronics, 2019-08, Vol.65 (3), p.274-283 [Periódico revisado por pares]

IEEE

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6
A 223Mbps FPGA Implementation of (10240, 5120) Irregular Structured Low Density Parity Check Decoder
A 223Mbps FPGA Implementation of (10240, 5120) Irregular Structured Low Density Parity Check Decoder
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Ata de Congresso 		Adicionar ao Meu Espaço

A 223Mbps FPGA Implementation of (10240, 5120) Irregular Structured Low Density Parity Check Decoder

Wang Wenjun ; Wu Xiaoguang ; Zhu Xiaoxuan ; Kang Guixia ; Tao Xiaofeng

VTC Spring 2008 - IEEE Vehicular Technology Conference, 2008, p.767-771

IEEE

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7
A 4.29nJ/pixel Stereo Depth Coprocessor With Pixel Level Pipeline and Region Optimized Semi-Global Matching for IoT Application
A 4.29nJ/pixel Stereo Depth Coprocessor With Pixel Level Pipeline and Region Optimized Semi-Global Matching for IoT Application
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A 4.29nJ/pixel Stereo Depth Coprocessor With Pixel Level Pipeline and Region Optimized Semi-Global Matching for IoT Application

Dong, Pingcheng ; Chen, Zhuoyu ; Li, Zhuoao ; Fu, Yuzhe ; Chen, Lei ; An, Fengwei

IEEE transactions on circuits and systems. I, Regular papers, 2022-01, Vol.69 (1), p.334-346 [Periódico revisado por pares]

New York: IEEE

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8
Accelerated and optimized covariance descriptor for pedestrian detection in self-driving cars
Accelerated and optimized covariance descriptor for pedestrian detection in self-driving cars
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Artigo 		Adicionar ao Meu Espaço

Accelerated and optimized covariance descriptor for pedestrian detection in self-driving cars

Abid, Nesrine ; Ammari, Ahmed. C. ; Al Maashri, Ahmed ; Abid, Mohamed ; Awadalla, Medhat

Design automation for embedded systems, 2023-09, Vol.27 (3), p.139-163 [Periódico revisado por pares]

New York: Springer US

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9
Accelerated Architectures Create Programming Opportunities
Accelerated Architectures Create Programming Opportunities
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Artigo 		Adicionar ao Meu Espaço

Accelerated Architectures Create Programming Opportunities

DeBenedictis, Erik P.

Computer (Long Beach, Calif.), 2018-06, Vol.51 (6), p.82-85 [Periódico revisado por pares]

New York: IEEE

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10
Accelerated FPGA-Based Vector Directional Filter for Real-Time Color Image Denoising with Enhanced Performance
Accelerated FPGA-Based Vector Directional Filter for Real-Time Color Image Denoising with Enhanced Performance
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Artigo 		Adicionar ao Meu Espaço

Accelerated FPGA-Based Vector Directional Filter for Real-Time Color Image Denoising with Enhanced Performance

Alanazi, Turki M.

Traitement du signal, 2023-06, Vol.40 (3), p.1251-1257 [Periódico revisado por pares]

Edmonton: International Information and Engineering Technology Association (IIETA)

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