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1
The TRON Project
The TRON Project
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The TRON Project

Sakamura, Ken

Information and software technology, 1996-03, Vol.38 (3), p.239-251 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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2
The Helix switch: a single chip cell switch design
The Helix switch: a single chip cell switch design
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The Helix switch: a single chip cell switch design

Patel, B. ; Schaffa, F. ; Willebeek-LeMair, M.

Computer networks and ISDN systems, 1996-10, Vol.28 (13), p.1791-1807 [Periódico revisado por pares]

Elsevier B.V

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3
Connected component labeling for binary images on a reconfigurable mesh architecture
Connected component labeling for binary images on a reconfigurable mesh architecture
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Artigo 		Adicionar ao Meu Espaço

Connected component labeling for binary images on a reconfigurable mesh architecture

Bhattacharya, Prabir

Journal of systems architecture, 1996-11, Vol.42 (4), p.309-313 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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4
Modular architecture for custom-built systems oriented to real-time computer vision: Application to color recognition
Modular architecture for custom-built systems oriented to real-time computer vision: Application to color recognition
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Modular architecture for custom-built systems oriented to real-time computer vision: Application to color recognition

Benítez-Díaz, Domingo

Journal of systems architecture, 1997-02, Vol.42 (9), p.709-723 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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5
A portable model for predicting the size and execution time of programs
A portable model for predicting the size and execution time of programs
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A portable model for predicting the size and execution time of programs

Axelsson, Jakob

Journal of systems architecture, 1997-03, Vol.43 (1), p.211-213 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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6
Dynamically reconfigurable heterogeneous multi-processor systems with transputer-controlled communication
Dynamically reconfigurable heterogeneous multi-processor systems with transputer-controlled communication
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Dynamically reconfigurable heterogeneous multi-processor systems with transputer-controlled communication

Tudruj, Marek

Journal of systems architecture, 1997-03, Vol.43 (1), p.27-32 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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7
Performance impact of run queue organization and synchronization on large-scale NUMA multiprocessor systems
Performance impact of run queue organization and synchronization on large-scale NUMA multiprocessor systems
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Performance impact of run queue organization and synchronization on large-scale NUMA multiprocessor systems

Dandamudi, S.P. ; Cheng, S.P.

Journal of systems architecture, 1997-04, Vol.43 (6), p.491-511 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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8
NETMAP: An integrated system for building analog neural networks
NETMAP: An integrated system for building analog neural networks
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NETMAP: An integrated system for building analog neural networks

Cancelo, Gustavo I.E. ; Hansen, Sten

Journal of systems architecture, 1997-10, Vol.44 (1), p.63-73 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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9
Multiple precision square root using the Dwandwa square-root algorithm
Multiple precision square root using the Dwandwa square-root algorithm
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Multiple precision square root using the Dwandwa square-root algorithm

Parthasarathi, Ranjani ; Jhunjhunwala, Ashok

Journal of systems architecture, 1997-11, Vol.44 (2), p.143-158 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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10
Architectural design of an RISC processor for programmable logic controllers
Architectural design of an RISC processor for programmable logic controllers
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Architectural design of an RISC processor for programmable logic controllers

Koo, Kyeonghoon ; Rho, Gab Seon ; Kwon, Wook Hyun ; Park, Jaehyun ; Chang, Naehyuck

Journal of systems architecture, 1998-02, Vol.44 (5), p.311-325 [Periódico revisado por pares]

Amsterdam: Elsevier B.V

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